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基于异或门自选通的低功耗时钟树综合方案
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本文介绍一种降低时钟网络功耗的方法.该方法基于电路中寄存器本身的状态值,在采用异或门进行自选通后构建时钟树结构,从而减少时钟信号额外翻转,降低芯片功耗.将该方法应用于一款基于SMIC0.18 μmEflash 2p4m工艺下的非接触式智能卡芯片的物理设计.仿真结果表明,与传统时钟树综合方法相比,芯片功耗降低了10.7％.
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来源 ：
中国集成电路
ISSN： 1681-5289
年份： 2014
期： 8
卷： 23
页码： 12-15
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