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作者:

胡锋 (胡锋.) | 柏璐 (柏璐.) | 林平分 (林平分.)

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摘要:

在设计ASIC的同时,必须引入DFT(可测性设计)以解决芯片的测试问题.在不影响功能模式下的时序的前提下,快速处理测试模式下的时序收敛显得越来越重要.本文基于扫描链的DFT模式,分析DFT模式下时序违反的基理,提出采用尽可能少的缓冲器解决时序违反.

关键词:

可测性设计 数据路径 时序 时钟树 时钟路径

作者机构:

  • [ 1 ] [胡锋]北京工业大学
  • [ 2 ] [柏璐]北京工业大学
  • [ 3 ] [林平分]北京工业大学

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来源 :

有线电视技术

ISSN: 1008-5351

年份: 2009

期: 9

卷: 16

页码: 93-95

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