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[期刊论文]
深亚微米全差分采样/保持电路设计
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本文介绍采用深亚微米CMOS工艺设计的全差分采样/保持电路,该电路应用下极板采样技术和全差分结构以消除开关电荷注入和时钟馈通引起的误差,从而获得高精度.设计采用0.18μm CMOS工艺条件并通过spectre软件模拟仿真,结果表明电路在3 V电源电压和50MHz采样频率工作条件下能够稳定工作.
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来源 ：
仪器仪表学报
ISSN： 0254-3087
年份： 2006
期： z1
卷： 27
页码： 145-147
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