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[会议论文]
基-16高效FFT信号处理器的FPGA实现
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设计了一种4096点FFT复数浮点运算处理器,其蝶形处理单元采用高效的基-16算法实现,该算法有效的结合了流水线和并行方式的特点,利用两级改进的基-4算法实现基-16运算核,仅用8个实数乘法器就可实现基-16蝶形单元的8次复数乘法运算,比传统的基-16算法节省75%的乘法器逻辑资源。实验仿真结果表明,用该算法设计的4096点复数基-16FFT处理器在100MHz的主时钟频率下运算速度为50.39μs,数据处理的速度和实时性方面有较大的提高。
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年份： 2007
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